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Display Engineer
Schnittstelle

MIPI-DSI-Displays

Serielle Hochgeschwindigkeitsdisplays für Linux- und Android-SoCs: RK3568, i.MX8, Raspberry Pi und ESP32-P4.

DEDisplay Engineer Applications Team · Display-ApplikationsingenieureVon Ingenieur geprüft am 11. Okt. 2026

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MIPI-DSI-Displays: Standardmodelle
ModellGrößeAuflösungSchnittstelleHelligkeit (cd/m²)FPC-PinsBlickwinkelTouchAbmessungen (mm)
PJ3506G01-31H30P400
PengJi
3.5″480×640MIPI DSI400306 o'clockOptional67.3 × 96.2 × 4.0Datenblatt anfordern
PJ3401T01-25H39P350
PengJi
3.5″800×800MIPI DSI300-50039Alle (IPS-Typ)Optional96.6 × 99.0 × 2.35Datenblatt anfordern
PJ5015B04-21H50P600
PengJi
5″480×854MIPI DSI200-600356 o'clockOptional56 × 120.05 × 2.2Alle Daten →
PJ5014H01-17H25P450
PengJi
5″720×1280MIPI DSI40025Alle (IPS-Typ)—65.35 × 118.8 × 2.0Datenblatt anfordern
PJ5501X01-16H39P500
PengJi
5.5″1080×1920MIPI DSI600-100039Alle (IPS-Typ)Optional64.3 × 118.2 × 1.55Datenblatt anfordern
PJ7010H01-26H30P300
PengJi
6.98″720×1280MIPI DSI200-50030Alle (IPS-Typ)Optional91.5 × 165.91 × 2.6Datenblatt anfordern
PJ7014H01-24H30P400
PengJi
7″1280×800MIPI DSI200-60030Alle (IPS-Typ)Optional161.2 × 105.5 × 2.4Datenblatt anfordern
PJ10109I02-25H40P200
PengJi
10.1″800×1280MIPI DSI20040Alle (IPS-Typ)—143 × 228.6 × 2.5Datenblatt anfordern

Wie MIPI DSI funktioniert

MIPI DSI überträgt Pixel über eine Takt-Lane und eine bis vier differenzielle Daten-Lanes auf der physikalischen D-PHY-Schicht. Jede Lane läuft üblicherweise mit 500 Mbit/s–1,5 Gbit/s, sodass eine 4-Lane-Verbindung 1920×1200 bei 60 Hz mit sehr wenigen Pins überträgt.

Panels arbeiten in einem von zwei Modi:

  • Video-Modus: Der Host streamt Pixel kontinuierlich, wie bei RGB. Das nutzen die meisten TFT-Panels von 5″ bis 10,1″.
  • Befehlsmodus: Das Panel hat einen eigenen Bildspeicher, und der Host sendet nur Aktualisierungen. Das ist bei kleinen AMOLEDs üblich und spart Energie.

Lane-Anzahl und Bandbreite

Auflösung @60 Hz

Rohbandbreite (24 Bit)

Mindestanzahl Lanes

720×1280

~1,3 Gbit/s

2

1024×600

~0,9 Gbit/s

2

1280×800

~1,5 Gbit/s

2–4

1920×1200

~3,3 Gbit/s

4

Reale Verbindungen brauchen etwa 20 % Reserve für Austastung und Protokoll-Overhead.

Checkliste zur Inbetriebnahme

  1. Lane-Anzahl und Lane-Reihenfolge im Device Tree abgleichen.
  2. Die Init-Sequenz des Panels (DCS-Befehle) vom Panellieferanten laden. Das ist der Schritt, der am häufigsten fehlt.
  3. Timing (Porches, Sync-Breiten, Pixeltakt) nach Datenblatt einstellen.
  4. Reset- und Einschaltreihenfolge prüfen: VCI/IOVCC, dann Reset, dann Initialisierung.
  5. DSI-Leiterbahnen kurz und impedanzkontrolliert halten (100 Ω differenziell).

Plattformhinweise: RK3568 und Raspberry Pi 5. Schnittstellenvergleich: MIPI DSI vs. LVDS vs. eDP.

Häufige Fragen

Warum bleibt mein MIPI-DSI-Display schwarz?

Die häufigsten Ursachen sind eine fehlende oder falsche Init-Sequenz, eine falsche Lane-Anzahl und eine falsche Reset- oder Einschaltreihenfolge. Bestätigen Sie zuerst die Init-Tabelle beim Panellieferanten und prüfen Sie dann den DSI-Takt mit einem Oszilloskop.

Kann ein Mikrocontroller ein MIPI-DSI-Display ansteuern?

Nur MCUs mit DSI-Host wie STM32F469/H747 oder ESP32-P4. Die meisten MCUs, auch der ESP32-S3, haben kein DSI; nutzen Sie dann RGB- oder SPI-Panels oder einen Bridge-Chip.

Wie lang darf ein MIPI-DSI-Kabel sein?

Halten Sie sie kurz, typisch unter 10–15 cm FPC. Für längere Strecken im Gehäuse ist LVDS robuster.

Unsicher, welches Display zu Ihrem Design passt?

Nennen Sie uns Größe, Schnittstelle und Host-Prozessor. Ein Display-Ingenieur antwortet innerhalb von 12 Stunden mit 2–3 Optionen, Datenblättern und Init-Code. Muster ab 1 Stk.